FPGA是什么?
这个页面描述了FPGA,其应用、福利、FPGA开发工具,代码开发步骤。现场可编程门阵列FPGA站。最常见的FPGA架构包含一个数组逻辑块称为可配置逻辑块或CLB, I / O垫和路由通道。一般来说,一个逻辑块即CLB由一些逻辑细胞称为ALM,勒、切片等。一个典型的细胞由4-input查找表(附近地区),一个完整的加法器(FA)和d型触发器。FPGA主要由附近地区,MUX和FF。了解FPGA功能让我们了解它的好处,应用程序和工具。
好处
FPGA是现今在快速变化的技术环境中更受欢迎,因为它的以下特点。
•简单的算法和提供可移植性re-program如果算法或技术未来的变化没有改变的硬件构建只有一次的设备。
•输入和输出响应时间快。
•比DSP更快的执行功能
•适合ASIC设计的原型将降低成本的重新设计和维护ASIC开发。
应用程序
主要用于移植的IP核或算法在嵌入式领域。它并不局限于特定的工程领域,但用于几乎所有包括机械、电气和无线领域。
例子——Xilinx virtex-5 FPGA
Virtex-5 fpga由硬连接IP系统级块作为例子,这里提到36-Kbit块RAM / fifo, 25 x 18 DSP片,选择IO™技术内置数字可控阻抗和芯片同步™源同步接口模块和系统监控功能,增强时钟管理模块以及集成数字时钟经理和锁相环时钟生成器和高级配置选项。SXT Virtex-5的蓝新特,TXT, FXT平台包括先进的高速串行连接和链接/事务层的能力。典型Xilinx FPGA资源,比如CLBs, DSP片,块内存块,cmt, PowerPC处理器模块、以太网mac,总I / O银行用户的I / O。
FPGA开发工具
任何算法都需要移植在FPGA开发的硬件描述语言(VHDL)或Verilog语言类似于其他编程语言。这些语言主要为硬件设计的可移植性和可配置性。
1。模型模拟:用于验证功能
2。XILINX ISE:用于合成
3所示。Synplify正方观点:用于合成
4所示。Lionardo谱:用于合成
硬件描述语言(VHDL) / verilog代码发展步骤
步骤1:需求- >硬件描述语言(VHDL)或Verilog代码- >模拟使用模型模拟和检查功能
第二步:验证硬件描述语言(VHDL)或verilog代码传递给合成工具(2/3或4)上面提到的生成优化的门级模型
第三步:通过优化门级模型”和路线”生成“计时模式”将满足时间约束。
步骤4:加载一些文件在FPGA和ASIC负载生成GDSII文件后将发髻。加载器或FPGA程序员可用,可以干扰电脑使用JTEG电缆
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有用的链接
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