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维特比译码器的MATLAB源代码

本节的MATLAB源代码覆盖维特比译码器matlab代码包括卷积编码器的维特比译码器规范约束长度的5。它提到的代码片段和步骤开发维特比译码器matlab代码。

规范的卷积编码器

卷积编码器(3、1,4)规范
编码率:1/3
约束长度:5
输出位长度:3
信息长度:1
最大内存/不。记忆的元素= 4
发电机多项式:25 (8),33 (8),37 (8)

规范的维特比译码器

码字长度:20
编码率:1/3
约束长度:5
追溯长度:20
量化级别:两个(艰难的决定类型)
发电机多项式:25 (8),33 (8),37 (8)

这个维特比上述卷积编码器的设计规范。请参考卷积编码器的基本知识卷积编码器matlab代码


维特比译码器MATLAB代码步骤

步骤1:连接三个连续的编码序列
%符号。

步骤2:为追溯转换表。

第三步:找到输入的长度和循环的时间单位。

步骤4:检查冗余状态


维特比译码器MATLAB代码

以下是维特比译码器的matlab代码。

函数[dec_op] = viterbi_decoder(收到过)
%连接三个连续的编码序列
%符号
输入= [];
j = 1:3:长度(收到过)
输入=[输入(接到(j) * 2 ^ 2) +(受到(j + 1) * 2 ^ 1) +(接到(j + 2) * 2 ^ 0));
结束

% %初始化输出表
Output_Table = […
0 0 7;…
1 7 0;…
2 3 4;…
3 4 3;…
4 5 2;…
5 2 5;…
6 6 1;…
7 1 6;…
7 3 4;…
8 4 3;…
9 0 7;…
10 7 0;…
11 - 6 1;…
12个1 6;…
13 5 2;…
14 2 5];

% %初始化下一个状态表(输出状态)
Next_State = […
0 0 8;…
1 0 8;…
2 1 9;…
3 1 9;…
4 2 10;…
5 2 10;…
6 3 11;…
7 3 11;…
8 4 12;…
9 4 12;…
10 5 13;…
11 5 13;…
12 6 14;…
13 6 14;…
14 7 15;…
15 7 15];

% % % % % % % % % % % % % % % % % % %
% T R A C E - B C K
% % % % % % % % % % % % % % % % % % %
slm = min (aem (:, 21));
slm_loc =找到(aem (: 21) = = slm);
sseq (21) = (slm_loc (1) 1);

t = 20: 1:1
sseq (t) = State_Hist (sseq (t + 1 + 1, t + 1);
结束

dec_op = [];
k = 1: 20
dec_op (k) = Transition_Table (sseq (k) + 1, sseq (k + 1 + 1);
结束


相关链接

注册并下载以下文章:
https://www.academia.edu/5406231/
Design_and_Implementation_of_Convolution_Encoder_with_Viterbi_Decoder

https://apt.cs.manchester.ac.uk/ftp/pub/apt/theses/Shao07_phd.pdf

MATLAB的有用链接代码

参考以下以及链接提到左侧面板上有用的MATLAB代码。
OFDM序言代时间估计corr频率下估计corr信道估计11 WLAN通道PN序列生成OFDMA Tx的处方AES DES载波聚合CCDF冷杉过滤器IIR滤波器低通冷杉维特比译码器CRC8 CRC32

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