3 - 8解码器硬件描述语言(VHDL)的源代码
这个页面的VHDL源代码覆盖3 - 8解码器硬件描述语言(vhdl)的代码。
硬件描述语言(VHDL)代码
图书馆IEEE;
使用IEEE.STD_LOGIC_1164.ALL;
使用IEEE.STD_LOGIC_ARITH.ALL;
使用IEEE.STD_LOGIC_UNSIGNED.ALL;
实体译码器
端口(s: STD_LOGIC_VECTOR(2报纸0);
y: STD_LOGIC_VECTOR(7报纸0));
结束译码器;
译码器的结构行为
开始
选取选择
y < = " 00000001 " " 000 "时,
“00000010”“001”时,
“00000100”“010”时,
“00001000”“011”时,
“00010000”“100”时,
“00100000”“101”时,
“01000000”“110”时,
“10000000”“111”时,
“00000000”当别人;
端行为;
使用IEEE.STD_LOGIC_1164.ALL;
使用IEEE.STD_LOGIC_ARITH.ALL;
使用IEEE.STD_LOGIC_UNSIGNED.ALL;
实体译码器
端口(s: STD_LOGIC_VECTOR(2报纸0);
y: STD_LOGIC_VECTOR(7报纸0));
结束译码器;
译码器的结构行为
开始
选取选择
y < = " 00000001 " " 000 "时,
“00000010”“001”时,
“00000100”“010”时,
“00001000”“011”时,
“00010000”“100”时,
“00100000”“101”时,
“01000000”“110”时,
“10000000”“111”时,
“00000000”当别人;
端行为;
硬件描述语言(VHDL)的有用链接代码
参考以及链接后左侧面板上提到的有用的VHDL代码。
D触发器
T触发器
阅读写内存
4 x1 MUX
4位二进制计数器
Radix4蝴蝶
16 qam调制
2位并行串行
射频和无线教程
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